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各大公司面試筆試

時(shí)間:2024-10-25 21:47:39 面試筆試 我要投稿
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各大公司面試筆試

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漢王筆試
下面是一些基本的數字電路知識問(wèn)題,請簡(jiǎn)要回答之。
a) 什么是Setup 和Holdup時(shí)間?
b) 什么是競爭與冒險現象?怎樣判斷?如何消除?
c) 請畫(huà)出用D觸發(fā)器實(shí)現2倍分頻的邏輯電路?
d) 什么是"線(xiàn)與"邏輯,要實(shí)現它,在硬件特性上有什么具體要求?
e) 什么是同步邏輯和異步邏輯?
f) 請畫(huà)出微機接口電路中,典型的輸入設備與微機接口邏輯示意圖(數據接口、控制接口、所存器/緩沖器)。
g) 你知道那些常用邏輯電平?TTL與COMS電平可以直接互連嗎?
2、 可編程邏輯器件在現代電子設計中越來(lái)越重要,請問(wèn):
a) 你所知道的可編程邏輯器件有哪些?
b) 試用VHDL或VERILOG、ABLE描述8位D觸發(fā)器邏輯。
3、 設想你將設計完成一個(gè)電子電路方案。請簡(jiǎn)述用EDA軟件(如PROTEL)進(jìn)行設計(包括原理圖和PCB圖)到調試出樣機的整個(gè)過(guò)程。在各環(huán)節應注意哪些問(wèn)題?
飛利浦-大唐筆試歸來(lái)
1,用邏輯們和cmos電路實(shí)現ab+cd
2. 用一個(gè)二選一mux和一個(gè)inv實(shí)現異或
3. 給了reg的setup,hold時(shí)間,求中間組合邏輯的delay范圍。
  Setup/hold time 是測試芯片對輸入信號和時(shí)鐘信號之間的時(shí)間要求。建立時(shí)間是指觸發(fā)器的時(shí)鐘信號上升沿到來(lái)以前,數據穩定不變的時(shí)間。輸入信號應提前時(shí)鐘上升沿(如上升沿有效)T時(shí)間到達芯片,這個(gè)T就是建立時(shí)間-Setup time.如不滿(mǎn)足setup time,這個(gè)數據就不能被這一時(shí)鐘打入觸發(fā)器,只有在下一個(gè)時(shí)鐘上升沿,數據才能被打入觸發(fā)器。保持時(shí)間是指觸發(fā)器的時(shí)鐘信號上升沿到來(lái)以后,數據穩定不變的時(shí)間。時(shí)hold time不夠,數據同樣不能被打入觸發(fā)器。

4. 如何解決亞穩態(tài)
5. 用verilog/vhdl寫(xiě)一個(gè)fifo控制器
6. 用verilog/vddl檢測stream中的特定字符串

用Q15表示出0.5和-0.5
揚智電子筆試
第一題:用mos管搭出一個(gè)二輸入與非門(mén)。
第二題:集成電路前段設計流程,寫(xiě)出相關(guān)的工具。
第三題:名詞IRQ,BIOS,USB,VHDL,SDR
第四題:unix 命令cp -r, rm,uname
第五題:用波形表示D觸發(fā)器的功能
第六題:寫(xiě)異步D觸發(fā)器的verilog module
第七題:What is PC Chipset?
第八題:用傳輸門(mén)和倒向器搭一個(gè)邊沿觸發(fā)器
第九題:畫(huà)狀態(tài)機,接受1,2,5分錢(qián)的賣(mài)報機,每份報紙5分錢(qián)。
華為面題
(硬件)
全都是幾本模電數電信號單片機題目
1.用與非門(mén)等設計全加法器
2.給出兩個(gè)門(mén)電路讓你分析異同
3.名詞:sram,ssram,sdram
4.信號與系統:在時(shí)域與頻域關(guān)系
5.信號與系統:和4題差不多
6.晶體振蕩器,好像是給出振蕩頻率讓你求周期(應該是單片機的,12分之一周期..
..)
7.串行通信與同步通信異同,特點(diǎn),比較
8.RS232c高電平脈沖對應的TTL邏輯是?(負邏輯?)
9.延時(shí)問(wèn)題,判錯
10.史密斯特電路,求回差電壓
11.VCO是什么,什么參數(壓控振蕩器?)
12. 用D觸發(fā)器做個(gè)二分顰的電路.又問(wèn)什么是狀態(tài)圖
13. 什么耐奎斯特定律,怎么由模擬信號轉為數字信號
14. 用D觸發(fā)器做個(gè)4進(jìn)制的計數
15.那種排序方法最快?

新太硬件面題
接著(zhù)就是專(zhuān)業(yè)題目啦
(1)d觸發(fā)器和d鎖存器的區別
(2)有源濾波器和無(wú)源濾波器的原理及區別
(3)sram,falsh memory,及dram的區別?
(4)iir,fir濾波器的異同
(5)冒泡排序的原理
(6)操作系統的功能
(7)學(xué)過(guò)的計算機語(yǔ)言及開(kāi)發(fā)的系統
(8)拉氏變換和傅立葉變換的表達式及聯(lián)系。

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