擴頻系統中卷積編碼的Verilog設計與仿真

全部作者： 王瑩 第1作者單位： 北京郵電大學(xué) 電信工程學(xué)院 數字通信與寬帶信息網(wǎng)絡(luò )實(shí)驗室 論文摘要： 為了改善數字通信系統的傳輸質(zhì)量，提高數字通信系統傳輸的可靠性引入了信道編碼，由于卷積編碼的優(yōu)良性能使其在通信系統中得到廣泛地應用。通過(guò)硬件描述語(yǔ)言Verilog HDL可以在QuartusII上建立卷積編碼的仿真模型。 關(guān)鍵詞： 卷積編碼，仿真，Verilog HDL，QuartusII (瀏覽全文) 發(fā)表日期： 2008年03月17日 同行評議：

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