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華為硬件研發(fā)筆試題

時(shí)間:2024-07-04 00:23:59 面試筆試 我要投稿
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華為硬件研發(fā)筆試題

  【華為硬件筆試題1】

華為硬件研發(fā)筆試題

  一 選擇 13個(gè)題目,沒(méi)有全部抄下來(lái),涉及的課程有電路,模擬電路,數字電路,信號與系統,微機原理,網(wǎng)絡(luò ),數字信號處理

  1.微分電路

  2.CISC,RISC

  3.數據鏈路層

  二 填空 10個(gè)題目,沒(méi)有全部抄下來(lái),涉及的課程有電路,模擬電路,數字電路,信號與系統,微機原理,網(wǎng)絡(luò ),數字信號處理

  1.TIC6000 DSP

  2.二極管

  3.RISC 4.IIR

  三 簡(jiǎn)答

  1.x(t)的傅立葉變換為X(jw)=$(w)+$(w-PI)+$(w-5) h(t)=u(t)-u(t-2)

  問(wèn): (1),x(t)是周期的嗎? (2),x(t)*h(t)是周期的嗎? (3),兩個(gè)非周期的信號卷積后可周期嗎?

  2.簡(jiǎn)述分組交換的特點(diǎn)和不足

  四 分析設計

  1.波形變換題目從正弦波->方波->鋸齒波->方波,設計電路

  2.74161計數器組成計數電路,分析幾進(jìn)制的

  3.用D觸發(fā)器構成2分頻電路

  4.判斷MCS-51單片機的指令正確還是錯誤,并指出錯誤原因 (1) MUL R0,R1 (2) MOV A,@R7 (3) MOV A,#3000H (4) MOVC @A+DPTR,A (5) LJMP #1000H () 5.MCS-51單片機中,采用12Mhz時(shí)鐘,定時(shí)器T0采用模式1(16位計數器),請問(wèn)在下面程序中,p1.0的輸出頻率 MOV TMOD,#01H SETB TR0 LOOP:MOV TH0,#0B1H MOV TL0,#0E0H LOOP1:JNB TF0,LOOP1 CLR TR0 CPL P1.0 SJMP LOOP

  【華為硬件筆試題2】

  全都是幾本模電數電信號單片機題目

  1.用與非門(mén)等設計全加法器   2.給出兩個(gè)門(mén)電路讓你分析異同   3.名詞:sram,ssram,sdram   4.信號與系統:在時(shí)域與頻域關(guān)系   5.信號與系統:和4題差不多  6.晶體振蕩器,好像是給出振蕩頻率讓你求周期(應該是單片機的,12分之一周期..   ..)   7.串行通信與同步通信異同,特點(diǎn),比較   8.RS232c高電平脈沖對應的TTL邏輯是?(負邏輯?)   9.延時(shí)問(wèn)題,判錯  10.史密斯特電路,求回差電壓   11.VCO是什么,什么參數(壓控振蕩器?)   12. 用D觸發(fā)器做個(gè)二分顰的電路.又問(wèn)什么是狀態(tài)圖   13. 什么耐奎斯特定律,怎么由模擬信號轉為數字信號   14. 用D觸發(fā)器做個(gè)4進(jìn)制的計數   15.那種排序方法最快?

  【華為硬件筆試題3】

 

  第一部分是:先給你一個(gè) 字符與文字對應的表,然后再給你幾個(gè)文字選出對應的字符組合。很簡(jiǎn)單,考察你的速度的,動(dòng)作要快,應該直接在答題卡上圖寫(xiě)答案。 第二部分就是考察智力的,就是找圖形數字的規律,然后讓你添一個(gè)空還有一些簡(jiǎn)單的計算,需要速度快,時(shí)間有點(diǎn)緊。第三部分就是一些你日常遇到的情況,你如何解決,這個(gè)沒(méi)有正確答案。接下來(lái)就是專(zhuān)業(yè)考試了,不同職位內容也不同。ASIC是數字電路的知識(還有點(diǎn)FPGA),大致如下: 1.簡(jiǎn)述數據在多時(shí)鐘域中跨時(shí)鐘域的幾種處理方法。 2.寫(xiě)一個(gè)簡(jiǎn)單邏輯電路的輸出,并化簡(jiǎn)。 3.用硬件描述語(yǔ)言(Verilog HDL或VHDL)寫(xiě)出FIFO控制器的程序。 4.用一個(gè)3-8譯碼器和一個(gè)或門(mén) 組成一個(gè)三人表決器兩個(gè)人或者兩個(gè)以上輸入1時(shí),輸出為1。 5.用于非門(mén)和非門(mén) 設計一個(gè)兩位二進(jìn)制數的平方器。 6.啥是零點(diǎn)漂移,在多級耦合的運放電路中的危害是啥,給出一個(gè)抑制零點(diǎn)漂移的電路,計算輸出表達式。 7.用邏輯電路實(shí)現一個(gè)三位二進(jìn)制數對3取模的電路。 8.畫(huà)出RS觸發(fā)器的電路圖。 9.設計一個(gè)監測連續3個(gè)1的序列監測器,當輸入3個(gè)或者多于3個(gè)1時(shí),輸出為1,畫(huà)出原始狀態(tài)圖,狀態(tài)表,并化簡(jiǎn)。

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