基于FPGA的RISC8位單片機設計

全部作者： 周啟民 楊福寶 第1作者單位： 武漢理工大學(xué) 信息工程學(xué)院 論文摘要： 本文基于FPGA和RISC的技術(shù)，用Verilog HDL語(yǔ)言設計了1個(gè)8位單片機，在QuartusⅡ下進(jìn)行軟件仿真，并在硬件上得到應用。這個(gè)處理器解決了目前常用嵌入式處理器的指令復雜、執行時(shí)間長(cháng)、執行效率低且硬件框架固定不可根據工程應用修改的缺陷。 關(guān)鍵詞：RISC、FPGA、Verilog HDL、8位單片機 關(guān)鍵詞： RISC，FPGA，Verilog HDL，8位單片機 (瀏覽全文) 發(fā)表日期： 2008年01月18日 同行評議：

1.摘要中對嵌入式單片機缺點(diǎn)的評價(jià)并不貼切。軟核的嵌入式單片機已經(jīng)得到廣泛的工程應用。2. 論文缺乏說(shuō)明為什么必須是分作8個(gè)部分，與目前通行的RISC單片機的劃分有何不同，如果是相同，那本文的單片機的優(yōu)特點(diǎn)又是如何體現的？3.本文的單片機共設計了多少條指令？最終實(shí)現了多少條指令？是否通過(guò)什么公認的測試手段說(shuō)明設計是有效的？對液晶YM12864的控制用到了多少條指令？4.為什么只有程序控制器模塊的結果？5. 本文單片機的優(yōu)點(diǎn)是通過(guò)與現有那類(lèi)單片機比較后得出的？比較的數據？　

綜合評價(jià)： 修改稿： 注：同行評議是由特聘的同行專(zhuān)家給出的評審意見(jiàn)，綜合評價(jià)是綜合專(zhuān)家對論文各要素的評議得出的數值，以1至5顆星顯示。

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