視頻監控系統中多畫(huà)面處理器的設計

摘要：以黑白四畫(huà)面處理為例，介紹了視頻監控系統中基于FPGA器件和單片機的多畫(huà)面處理器的設計方法，簡(jiǎn)述了FPGA器件XCS05XL的特點(diǎn)和工作原理，討論了單片機μPD78F0034與I2C總線(xiàn)存儲器X24C16的接口方法以及用μPD6453疊加字符的基本方法，同時(shí)概述了使用幀存儲器AL422應注意的幾個(gè)問(wèn)題。

近年來(lái)，隨著(zhù)視頻監控系統在各個(gè)領(lǐng)域的廣泛應用，作為視頻監近系統組成之一的多畫(huà)面處理器的應用也愈來(lái)愈普遍。如使用一臺九畫(huà)面處理器，則可在一臺監視器上同時(shí)監控9個(gè)目標，只需使用一臺錄像機便可對9路視頻信號同時(shí)實(shí)時(shí)錄像。目前多畫(huà)面處理器有黑白/彩色四、九、十六畫(huà)面處理器等6種類(lèi)型。一般說(shuō)來(lái)，多畫(huà)面處理器除了有畫(huà)面分割功能外，還須有視頻信號切換及報警功能。視頻信號功換功能是指多畫(huà)面處理器有一路視頻輸出是輸入視頻信號或畫(huà)面分割信號的順序切換，且切換時(shí)間可調；報警功能是指多畫(huà)面處理器能輸入、輸出報警信號，報警時(shí)相應的畫(huà)面上疊加有報警信息，并將報警信息存儲起來(lái)以便日后查閱。設計多畫(huà)面處理器可使用專(zhuān)用DSP芯片，這樣雖然滿(mǎn)足了速度要求，但開(kāi)發(fā)周期較長(cháng)，產(chǎn)品的調試、修改及升級比較困難，成本較高。由于FPGA（即現場(chǎng)可編程門(mén)陣列）器件具有集成度高、體積小、功耗低、設計靈活且價(jià)格較低，有快速高效的開(kāi)發(fā)平臺，可加快開(kāi)發(fā)周期等優(yōu)勢，因此目前多畫(huà)面處理器的設計基本上采用FPGA作為其中的視頻信號處理器件。由于FPGA的功能由其內部的編程數據確定，編程數據的裝載方法之一是上電后由單片機實(shí)現，因此多畫(huà)面處理器含有單片機。一方面利用單片機在上電后將FPGA所需的編程數據寫(xiě)入FPGA中，另一方面視頻信號的切換、字符疊加及報警信息的處理也由單片機來(lái)完成。下面具體介紹基于FPGA器件和單片機的黑白四畫(huà)面處理器的設計方法。

1 黑白四畫(huà)面處理器的組成及主要功能

1.1 黑白四畫(huà)面處理器的組成

黑白四畫(huà)面處理器的方框圖如圖1所示。由圖1可知，該多畫(huà)面處理器以FPGA器件和單片機為核心，外加A/D、D/A、幀存儲器、串行存儲器、串行時(shí)鐘和字符疊加等輔助芯片組成。

1.2黑白四畫(huà)面處理器的主要功能

該四畫(huà)面處理器主要功能如下：

·視頻格式為CCIR模式，即視頻信號的場(chǎng)頻為50Hz；

·雙工操作（在錄像的同時(shí)可進(jìn)行回放），菜單設定；

·全屏顯示時(shí)象素為1024×512,256個(gè)灰度等級；

·4路CVBS輸入及1路錄像輸入；

·1路全畫(huà)面與四分割切換輸出，1路錄像輸出（固定四分割）；

·切換時(shí)間可調，范圍為1～255s。

·畫(huà)面上可疊加時(shí)間日期，且位置可調整；

·有報警輸入輸出功能，報警復位時(shí)間的可調范圍為1～300s；

·有視頻信號丟失報警功能，報警時(shí)對應的畫(huà)面上有文字顯示。

2 各部分電路的結構及工作原理

2.1 輸入緩沖及A/D轉換

該部分電路的主要功能是將輸入的模擬視頻信號轉換成數字視頻信號供FPGA器件處理，其方框圖如圖2所示。4路視頻信號經(jīng)過(guò)受FPGA控制的模擬多路選擇器后，輸出2路視頻信號，經(jīng)過(guò)緩沖放大后送到受FPGA控制的模擬開(kāi)關(guān)；然后再輸出給A/D，2路視頻信號需要2片A/D芯片。A/D芯片選TLC5510，該芯片是一種分辨率為8位、20MSPS（20兆采樣點(diǎn)/秒）的CMOS模/數轉換器。在FPGA的控制下，TLC5510將輸入的模擬視頻信號轉換成數字視頻誤，然后送往幀存儲器。

2.2 幀存儲器

幀存儲器選AVERLOGIC公司的AL422，共需要2片。AL422是存儲量為384KB×8Bits的FIFO（First In First Out）DRAM，它支持VGA、CCIR、NTSC、PAL和HDTV分辨率，具有獨立的讀/寫(xiě)操作及輸出使能控制；存儲時(shí)間為15ns的高速異步串行存取，可在5V或3.3V電源電壓下工作，標準的28腳SOP封裝。

2.3 FPGA器件

FPGA是本設計的核心，與傳統邏輯電路和門(mén)陣列相比具有不同的結構。FPGA利用小型查找表（16×1RAM）來(lái)實(shí)現組合邏輯，每個(gè)查找表連接到一個(gè)D觸發(fā)器的輸入端，D觸發(fā)器再來(lái)驅動(dòng)其它邏輯或驅I/O。這些模塊利用金屬連線(xiàn)互相連接或連接到I/O模塊。FPGA通過(guò)向內部靜態(tài)存儲單元加載編程數據來(lái)實(shí)現其FPGA通過(guò)向內部靜態(tài)存儲單元加載編程數據來(lái)實(shí)現其邏輯，存儲在存儲單元中值決定了FPGA實(shí)現的功能；FPGA的這種結構允許無(wú)限次的重新編程。由此可見(jiàn)，用FPGA設計的產(chǎn)品調試修改及升級均很容易，且具有很大的靈活性。目前FPGA的種類(lèi)很多，在本設計中選用Spartan系列的XCS05XL。該芯片是Xilinx公司推出的低價(jià)格、高性能的FPGA，其主要特點(diǎn)如下：

·系統門(mén)的數目達到了5000，Logic cell數目達到了238，系統資源豐富；

·具備片上可編程分布式RAM，最多可編程的RAM達3200bit；

·分布式算術(shù)邏輯單元，支持分布式DSP運算；

·靈活的高速時(shí)鐘網(wǎng)絡(luò )，內部三態(tài)總線(xiàn)；工作電壓為3.3V。

有關(guān)XCS05XL的詳細資料請參閱參考文獻[1]。

FPGA的編程數據存儲在單片機的FLASH ROM里。每次上電后單片機將編程數據裝入XCS05XL，編程模式選從串模式，因而其22腳（M1）和24腳（M0）懸空。編程數據裝入后，XCS05XL的邏輯功能就確定了；XCS05XL控制視頻信號的輸入及A/D轉換，在其內部將每路視頻信號壓縮為原來(lái)的1/2，同時(shí)在單片機的控制下給每路疊加時(shí)間、日期、通道數字字符信息，然后將壓縮的四路視頻信號合成為

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